パイプライン型剰余乗算器を用いたペアリング計算器のFPGA実装による消費エネルギー評価 (ハードウェアセキュリティ)

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パイプライン型剰余乗算器を用いたペアリング計算器のFPGA実装による消費エネルギー評価

(ハードウェアセキュリティ)

国立国会図書館請求記号
Z16-940
国立国会図書館書誌ID
028976016
資料種別
記事
著者
長浜 佑介ほか
出版者
東京 : 電子情報通信学会
出版年
2018-04-13
資料形態
掲載誌名
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 118(3):2018.4.13
掲載ページ
p.23-28
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書誌情報

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資料種別
記事
著者・編者
長浜 佑介
藤本 大介
坂本 純一
松本 勉
シリーズタイトル
並列タイトル等
Energy Evaluation of FPGA Pairing Implementation with Pipeline Modular Multiplier
タイトル(掲載誌)
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報
巻号年月日等(掲載誌)
118(3):2018.4.13
掲載巻
118
掲載号
3