FPGAアクセラレータを用いた三次元ステンシル計算における電力性能モデルの検討 (リコンフィギャラブルシステム)

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FPGAアクセラレータを用いた三次元ステンシル計算における電力性能モデルの検討

(リコンフィギャラブルシステム)

Call No. (NDL)
Z16-940
Bibliographic ID of National Diet Library
024925912
Material type
記事
Author
土肥 慶亮ほか
Publisher
東京 : 電子情報通信学会
Publication date
2013-09
Material Format
Paper
Journal name
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113(221):2013.9.18・19
Publication Page
p.19-24
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Paper

Material Type
記事
Author/Editor
土肥 慶亮
福本 航太
柴田 裕一郎 他
Alternative Title
A Power-Performance model for 3-D stencil computation on an FPGA accelerator
Periodical title
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報
No. or year of volume/issue
113(221):2013.9.18・19
Volume
113
Issue
221