不揮発メモリの書き込み削減手法のための小面積なエンコーダ/デコーダ回路構成 (VLSI設計技術 ; デザインガイア2014 : VLSI設計の新しい大地)

不揮発メモリの書き込み削減手法のための小面積なエンコーダ/デコーダ回路構成

(VLSI設計技術 ; デザインガイア2014 : VLSI設計の新しい大地)

Journal name: 電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114(328):2014.11.26-28

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Material Type: 記事
Title: 不揮発メモリの書き込み削減手法のための小面積なエンコーダ/デコーダ回路構成
Author/Editor: 多和田雅師
木村晋二
柳澤政生他
Series Title: VLSI設計技術 ; デザインガイア2014 : VLSI設計の新しい大地
Author Heading: 多和田雅師
木村晋二
柳澤政生
Alternative Title: Small-Sized Encoder/Decoder Circuit Design for Bit-Write Reduction Targeting Non-Volatile Memories
Periodical title: 電子情報通信学会技術研究報告 = IEICE technical report : 信学技報
No. or year of volume/issue: 114(328):2014.11.26-28
Volume: 114
Issue: 328
Pages: 227-232
Publication date of volume/issue (W3CDTF): 2014-11
ISSN (Periodical Title): 0913-5685
ISSN-L (Periodical Title): 0913-5685
Publication (Periodical Title): 東京 : 電子情報通信学会
Place of Publication (Country Code): JP
Text Language Code: jpn
Subject Heading: 不揮発メモリ
書き込み削減
誤り訂正符号
Non-volatile memory
Writing-reduction code
Error correcting code
NDLC: ZN33
Target Audience: 一般
Report No. (Article): VLD2014-106
Holding library: 国立国会図書館
Call No.: Z16-940
Data Provider (Database): 国立国会図書館 : 国立国会図書館雑誌記事索引
https://ndlsearch.ndl.go.jp
Bibliographic ID (NDL): 025983269
http://id.ndl.go.jp/bib/025983269
Bibliographic Record Category (NDL): 632