Ultra Low Power (ULP) Challenge in System Architecture Level : New architectures for 45-nm, 32-nm era

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Ultra Low Power (ULP) Challenge in System Architecture Level : New architectures for 45-nm, 32-nm era

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Note (General)：: 12th Asia and South Pacific Design Automation Conference（ASP-DAC 2007） : 2007年1月23日～26日 : パシフィコ横浜, 神奈川

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Material Type: 文書・図像類
Title: Ultra Low Power (ULP) Challenge in System Architecture Level : New architectures for 45-nm, 32-nm era
Author/Editor: 佐藤, 寿倫
Author Heading: 佐藤, 寿倫サトウ, トシノリ
Publication, Distribution, etc.: 九州大学システムLSI研究センター
Publication Date: 2007-01-23
Publication Date (W3CDTF): 2007-01-23
Periodical title: SLRC プレゼンテーション
Text Language Code: eng
Subject Heading: Ultra Low Power
ULP
低消費電力
Target Audience: 一般
Note (General): 12th Asia and South Pacific Design Automation Conference（ASP-DAC 2007） : 2007年1月23日～26日 : パシフィコ横浜, 神奈川
Access Restrictions: インターネット公開
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Data Provider (Database): 国立情報学研究所 : 学術機関リポジトリデータベース（IRDB）（機関リポジトリ）
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Original Data Provider (Database): 九州大学 : 九州大学学術情報リポジトリ