FPGAを用いた Latching Scaler 回路の試作

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Note (General)：: type:発表資料平成22年度熊本大学総合技術研究会，回路・計測・制御技術分野（口頭発表）セッションIIIidentifier:http://www.tech.eng.kumamoto-u.ac.jp/kumamoto2011/

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Material Type: 文書・図像類
Title: FPGAを用いた Latching Scaler 回路の試作
Author/Editor: 伊藤, 康彦
今津, 節男
長壁, 正樹
中西, 秀哉
Author Heading: 伊藤, 康彦
今津, 節男
長壁, 正樹
中西, 秀哉
Publication, Distribution, etc.: 熊本大学工学部技術部
Publication Date: 2011-03-18
Publication Date (W3CDTF): 2011-03-18
Alternative Title: FPGA オモチイタ Latching Scaler カイロノシサク
Text Language Code: jpn
Subject Heading: 429.6
Target Audience: 一般
Note (General): type:発表資料
平成22年度熊本大学総合技術研究会，回路・計測・制御技術分野（口頭発表）セッションIII
identifier:http://www.tech.eng.kumamoto-u.ac.jp/kumamoto2011/
Access Restrictions: 限定公開
Data Provider (Database): 国立情報学研究所 : 学術機関リポジトリデータベース（IRDB）（機関リポジトリ）
https://irdb.nii.ac.jp
Original Data Provider (Database): 熊本大学 : 熊本大学学術リポジトリ